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FPGA中两个模块间怎么传输大数据 FPGA论坛 jlgcumt 2013-11-3 2 1717 Backkom80 2013-11-5 07:57
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FPGA论坛 AnHongliang 2013-10-18 0 1333 AnHongliang 2013-10-18 16:44
求助:modelsim中如何对VHDL仿真 FPGA论坛 nm2012 2013-10-16 7 1862 ococ 2013-10-17 15:28
用verilog描述ROM遇到问题,请各位帮忙纠错
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EDA 技术 vol2088 2013-10-14 3 2001 gaochy1126 2013-10-31 23:43
关于用的FPGA做位同步时钟提取问题,求大神进来指导! FPGA论坛 hutianyu 2013-10-9 10 1670 haitaox 2013-10-15 16:12
please use verilog to implement the programmable _nT_pulse function FPGA论坛 zhuxinyu2008 2013-10-9 0 1553 zhuxinyu2008 2013-10-9 09:51
FPGA用verilog点亮一个led,用了两种方法有疑问求教!
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vivado 里从哪设置生成ip的语言
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Vreilog 的sourceinsight 插件 attachment FPGA论坛 xygyszb 2013-8-29 4 1525 xygyszb 2013-8-30 14:05
求助这段verilog点灯程序咋理解
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FPGA论坛 flyhouse112 2013-8-26 5 2700 flyhouse112 2013-8-29 10:02
要是电路的原理图能用verilog画就好了 FPGA论坛 luyaker 2013-9-5 6 1479 GoldSunMonkey 2013-9-6 23:06
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