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CPLD程序编译通过，下载后运行无反应 attach_img
CPLD ，编译 ，verilog ，仿真 ，原理图
FPGA论坛 麟凤龟龙 2015-8-9 0 1341 麟凤龟龙 2015-8-9 10:44
初学Verilog，出现的错误解决不了，求帮忙
verilog ，TI ，se ，ce ，PROCESS
FPGA论坛 夏天的微笑 2015-8-8 5 9706 littbi 2017-12-17 11:09
关于MBI5153的问题 attach_img
mb ，verilog ，时序 ，芯片 ，verilo
FPGA论坛 yaorh 2015-7-3 1 2659 yulunna 2015-7-3 12:24
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mb ，verilog ，时序 ，芯片 ，verilo
EDA 技术 yaorh 2015-7-2 4 3353 lxs_14 2018-5-6 20:52
如何通过fpga对4路地址线进行16路的扩展
FPGA ，verilog ，verilo ，代码 ，单板
嵌入式操作系统论坛 Projectaker 2015-6-15 1 777 yulunna 2015-6-16 15:36
verilog有格式化工具吗
verilog ，代码 ，C语言 ，软件 ，UART
FPGA论坛 huangxz 2015-6-9 2 3045 huangxz 2015-6-11 14:10
verilog使用规范
verilog ，FOR ，仿真 ，电路 ，se
FPGA论坛 shaoyuan02 2015-5-20 3 1020 lxy_613 2015-6-9 10:51
verilog快速掌握之模块例化
verilog ，信号 ，UART ，USB模块 ，硬件
FPGA论坛 shaoyuan02 2015-5-20 0 1761 shaoyuan02 2015-5-20 14:42
verilog快速掌握之程序设计
verilog ，ge ，edge ，se ，POS
FPGA论坛 shaoyuan02 2015-5-20 2 887 windycraze 2015-5-29 10:19
VERILOG里面else if语句最多能有多少个？
verilog ，se ，时钟 ，解码 ，FOR
FPGA论坛 ysdx 2015-5-7 6 8075 会飞的猪Kevin 2015-6-11 16:41
用CPLD/VERILOG写串行FLASH，代码难度如何？
CPLD ，flash ，verilog ，代码 ，ARM
FPGA论坛 magic_yuan 2015-3-19 3 1166 zkf0100007 2015-3-23 11:02
FPGA实战演练逻辑篇4：Verilog与VHDL
FPGA ，verilog ，VHDL ，C语言 ，逻辑器件
FPGA论坛 rousong1989 2015-3-16 0 669 rousong1989 2015-3-16 11:58
CPLD verilog 开发属于硬件开发还是软件开发
CPLD ，verilog ，软件开发 ，硬件开发 ，控制
FPGA论坛 wangjianf5 2015-2-25 6 2750 habc987 2015-2-28 22:30
FPGA的资料，可以看看 attachment
FPGA ，PGA ，verilog ，周立功 ，verilo
EDA 技术 风魔小象 2015-2-1 7 1031 ASSRIENT 2015-3-22 11:30
【资料大盘点】多年积攒的精华啊
CAD ，AD ，ce ，verilog ，cadence
电子技术交流论坛 胡斯哲 2015-1-29 5 1115 wtzc 2015-2-3 10:52
FPGA入门：Verilog/VHDL语法学习的经验之谈
VHDL ，verilog ，FPGA ，代码 ，电路
FPGA论坛 rousong1989 2015-1-29 0 994 rousong1989 2015-1-29 09:20
modelsim10.2C**后提示错误，以及如何进行verilog vhdl混合仿真
modelsim ，仿真 ，verilog ，VHDL ，AD
FPGA论坛 951729153 2015-1-27 1 3533 ococ 2015-1-29 08:43
请教Verilog中case书写用法
verilog ，verilo ，se
FPGA论坛 s_h_q 2015-1-6 2 2060 littbi 2017-12-17 11:19
请问VERILOG 的U_PixFifo是什么意思？
FIFO ，pi ，verilog ，ST ，lm
FPGA论坛 net_wolf 2015-4-23 2 759 net_wolf 2015-4-25 09:03
刚学Verilog，编了下面的程序，仿真时运行出不来结果 attach_img
verilog ，仿真 ，verilo ，FOR ，ni
FPGA论坛 JasonnLee 2015-7-28 1 1409 littbi 2017-12-17 11:07
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