Xilinx RapidIO IP核不能生成bit文件求大神指教
2013-12-10 19:48
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您好，请问rapidio搞定了吗？最近我也刚开始看这个，以后有问题能向你多请教下吗？哈哈 3# moyichen123 ...
spartan6的serial rapidIO 的IP有人用过米有？
2012-7-16 13:39
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您好，我最近也在做DSP与FPGA之间的rapidio接口，哈哈，以后多多向您请教啊 3# lelee007 ...
以Spartan3E开讲Xilinx FPGA 内部结构（10.5更新，位于88楼）
2015-7-30 11:35
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话说是直接点击评分就算给分了吗？猴哥 2# GoldSunMonkey
lvds时钟输出的问题!!!
2012-2-7 17:27
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可以人工再加个bufg对吗？猴哥是这个意思吗？一般DCM的输出不是加个BUFG吗，然后再加差分驱动 20# GoldSunM ...
chipscope使用问题
2011-12-12 14:14
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可以的，如果找不到，你可以引到顶层几个信号与下输出 7# 674467523
关于名字“受不了你”的说明
2011-12-12 20:43
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其实自己也很不想用这个名字，但是申请别的名字的时候，老是提醒我包含敏感字眼之类的，好几个都这样，最后 ...
各位大仙，logic levels的问题 ，谢谢
2011-12-12 19:36
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chipscope 怎没出现这个问题呢， 望用过的给个解答呗，多谢了
2011-12-9 08:53
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为什么注册不了，大家帮忙看看
2011-12-29 23:45
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Bulit— in fifo 与blockram 区别
2011-12-1 12:54
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FWFT相比FIFO有什么优势吗
2012-2-2 22:01
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如何使用xilinx的MIG
2012-1-1 21:41
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GSM给您解释解释XILINX XST综合的选项的含义（完成）
2013-3-28 18:13
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赛灵思rapidIO IP核自带的实例问题请教
2013-9-4 20:13
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多的不说,一句话: 感谢GSM猴哥
2011-11-23 15:32
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整个BANK的IO都不用，对应的VCCO是不是可以不加滤波电容
2011-12-1 20:51
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用FIFO的时候，用原语与用IP什么区别啊
2011-12-1 19:03
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13.1生成的bit流能用13.3ISE版本的chipscope加载吗
2011-12-18 21:54
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