reg型数组的初始化配置问题
2014-4-4 17:53
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如果是altera，所有节点上电init的时候就为0了
AD采样问题
2014-4-15 14:06
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ISE我用的少，不太清楚
但是我研究过altera和xilinx芯片结构对比
它们的IOE结构类似、都有double data in ...
xilinx肯定有啊
且不管你数据出错，你的同步方法有问题
既然是双通道，1通道对应时钟上升沿，2通道对于时钟下降沿，那么 ...
400MHZ采200Mhz，FPGA已经被你奸的凌乱了，还是想人家正常的给你显示波形？
示波器能看到就足够了，采样有 ...
.
2014-8-21 00:32
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帮顶，祝早日找到心目中的那位，同时注意自身安全，要到公众场合赴约
2块板子通信，如何使时钟同步【求助】
2016-11-16 19:58
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时钟不可能同步，只能同步处理进程
求推荐佛山的驾校
2014-3-27 11:35
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本人在广州上班，想去佛山练车，求推荐驾校啊
FPGA中数据与时钟同步设计
2014-2-17 22:35
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请人一起做项目
2014-5-20 09:26
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待遇
2014-3-11 23:27
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FPGA时钟双沿采数
2014-4-21 10:46
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离职，公司却强烈挽留
2014-1-27 12:08
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没有面试通知，直接去公司面试，他们会给机会么？
2013-11-23 12:21
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或许自己没有竞争力，fpga的工作真难找！
2013-12-6 22:47
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步入房奴行列
2013-11-19 13:50
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最近心态不好，想辞职（最终结果——1楼）
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SOPC如何优化
2013-12-26 20:11
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