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请教:verilog实现的UART模块中波特率的时钟分频问题…… FPGA论坛 yuxiang2008 2012-4-18 9 5921 hawksabre 2012-12-27 18:28
verilog 赋初值的问题
verilogTPUOutputgeInput
新手园地 就是一枪 2012-4-16 1 2964 zuxingshui 2012-4-17 23:22
Verilog中参数型常量问题 FPGA论坛 aikimi7 2012-4-12 7 3495 liedc 2012-4-24 10:22
请问FPGA,DSP,Verilog,matlab之间是什么关系? FPGA论坛 jbbppa 2012-4-9 5 4198 GoldSunMonkey 2012-4-12 10:52
一个verilog的问题:用户自定义原语(UDP)是不是无法综合? FPGA论坛 lonelyking1716 2012-3-26 1 2595 GoldSunMonkey 2012-3-26 21:02
Verilog小数定标问题 FPGA论坛 aikimi7 2012-3-26 6 2443 aikimi7 2012-3-28 20:24
Verilog小数定标问题 FPGA论坛 aikimi7 2012-3-26 0 1551 aikimi7 2012-3-26 10:10
verilog 的IEEE标准 1364-2001 attachment FPGA论坛 viatuzi 2012-3-24 2 2396 GoldSunMonkey 2012-9-7 17:56
请教个verilog问题.想不明白
verilogmoduleFORninpu
FPGA论坛 zjsyjbb 2012-3-23 8 1987 GoldSunMonkey 2012-3-26 20:52
运行频率和时钟频率的区别 attach_img FPGA论坛 aikimi7 2012-3-22 6 2437 aikimi7 2012-3-23 10:02
流水线设计 attach_img FPGA论坛 aikimi7 2012-3-22 1 1441 Backkom80 2012-3-22 10:09
新手学习官方文档可行吗?quartus之后还需要学习什么? FPGA论坛 mathematical 2012-3-20 5 2308 Backkom80 2012-3-22 10:18
求助:inout端口在test文件里面作为输入怎么用
inout端口TESTsdverilog
FPGA论坛 梦境缠绕 2012-3-14 3 1876 Backkom80 2012-3-15 12:45
请教一个verilog的问题
verilogADDRDDRseaddress
FPGA论坛 c1apton 2012-3-14 21 3249 GoldSunMonkey 2012-3-16 16:58
请问一下关于distributed memory generator的ip核 FPGA论坛 wwuchang 2012-3-12 6 3410 GoldSunMonkey 2012-3-13 19:42
一套北大verilog课件,不知道坛子里有了没?先放上来。。。 attachment 德州仪器MCU zgsxhzac 2012-3-10 0 1661 zgsxhzac 2012-3-10 22:13
在FPGA/CPLD开讲Verilog HDL语言 FPGA论坛 GoldSunMonkey 2012-3-8 13 2179 hihu 2012-3-12 17:17
紧急help:这个verilog文件xst check syntax报错 attachment
STckverilogHDLhd
FPGA论坛 edacsoft 2012-3-15 3 3041 GoldSunMonkey 2012-3-15 19:19
请教兄弟们一个verilog的程序问题 FPGA论坛 skiry 2012-3-27 7 2154 skiry 2012-3-28 08:27
为什么要学verilog
verilogveriloHDLVHDLhd
EDA 技术 海川先生 2012-4-1 11 2633 热血的人 2012-5-26 10:42