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verilog模块里输入信号的问题 FPGA论坛 nm2012 2013-4-30 6 2194 GoldSunMonkey 2013-5-1 16:06
刚学verilog,问3个小问题 FPGA论坛 nm2012 2013-4-28 34 3834 GoldSunMonkey 2013-5-6 21:21
求Verilog $timeformat 的用法~
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USB技术专区 pangning7085 2013-4-24 4 8490 1wedddssf 2018-8-19 22:32
关于用Verilog函数读写文件的问题 FPGA论坛 Rain_King 2013-4-21 5 3450 Rain_King 2013-4-22 15:06
求助用VHDL/verilog实现16QAM调制 FPGA论坛 1025004405 2013-4-19 1 2292 sherld 2013-4-27 10:02
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FPGA语言综合有什么作用 attach_img
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fpga的verilog 代码求救
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verilog hdl中是否有取整操作(函数或指令) FPGA论坛 xuxin5406 2013-4-14 5 10702 xuxin5406 2013-4-16 19:08
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EDA 技术 feihong777 2013-4-12 6 1919 yangfchn 2013-10-23 23:46
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EDA 技术 jakfens 2013-4-9 2 1668 GoldSunMonkey 2013-4-10 22:24
如用用Verilog HDL 实现CPLD与DPS之间的数据传递?
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新手园地 pan315449340 2013-4-8 3 1745 pan315449340 2013-4-10 21:53
verilog中复位为何用下降沿 FPGA论坛 magic_yuan 2013-4-5 6 6169 jahnson066 2013-4-6 13:40
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万利电子 yybj 2013-3-26 3 2998 xsgy123 2013-3-26 20:03
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求教关于VHDL和Verilog HDL的问题 FPGA论坛 pangning7085 2013-3-21 14 2622 GoldSunMonkey 2013-3-27 23:18