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verilog的uart怎么设计
UART ，verilog ，verilo
EDA 技术 hudi008 2014-4-13 3 721 gaochy1126 2012-7-20 23:44
PCF8563（verilog读取） 老是显示00
PCF8563 ，verilog ，寄存器 ，ST ，TE
侃单片机论坛 fwfjndx 2014-4-13 4 1541 outstanding 2014-4-19 09:40
reg型数组的初始化配置问题
FOR ，Reset ，verilog ，代码 ，寄存器
FPGA论坛 supers001 2014-4-3 3 1326 痴小吃 2014-4-4 17:53
verilog中的reg型变量，wire型变量初值是多少？？
verilog ，Wire ，se ，时钟 ，ni
EDA 技术 52mcu 2014-4-1 3 3261 gaochy1126 2014-4-29 23:33
Verilog HDL语言中可综合问题
hdl语言 ，verilog ，Verilog语言 ，FOR ，TI
FPGA论坛 tgi8i 2014-3-27 2 1348 tgi8i 2014-3-28 12:32
verilog hdl程序问题
verilog ，HDL ，TE ，counter ，module
FPGA论坛 tgi8i 2014-3-26 5 1213 bitshiyan 2014-3-27 15:07
求“基于FPGA的温度数据无线传输系统设计”的整套Verilog HDL程序
FPGA ，HDL ，verilog ，温度数据 ，无线传输系统
EDA 技术 bingtang 2014-3-25 0 1316 bingtang 2014-3-25 10:58
如何用verilog实现时钟的相位延迟？
verilog ，时钟 ，相位 ，verilo
FPGA论坛 技术达人 2014-2-24 2 4635 GoldSunMonkey 2014-3-6 00:08
verilog 今日心得
verilog ，电路 ，硬件电路 ，硬件 ，计数器
FPGA论坛 TataJen 2014-2-16 6 1354 丁弋宇 2014-2-19 16:06
VHDL调用verilog奇怪的问题
VHDL ，verilog ，仿真 ，Input ，TPU
FPGA论坛 drentsi 2014-1-8 2 1907 jidushen 2018-5-7 17:21
关于用FPGA实现PWM延迟（死区）的verilog hdl程序请指正 attach_img
FPGA实现 ，verilog ，PWM ，HDL ，ge
FPGA论坛 bowlder2008 2014-1-6 6 6230 hanqingynu 2015-4-11 22:01
求推荐学习FPGA开发板，用Verilog
verilog ，FPGA开发板
电子技术交流论坛 h202234 2014-1-4 0 917 h202234 2014-1-4 21:13
verilog 代码奇怪的问题求助！！！
verilog ，代码 ，FIFO ，ST ，DDR
FPGA论坛 dyt3020 2014-1-3 1 1532 dyt3020 2014-1-3 14:30
Verilog的问题
verilog ，verilo
EDA 技术 houjiakai 2013-12-3 6 1503 happyming0809 2013-12-5 11:16
求ili9325 verilog 代码
verilog ，代码 ，verilo ，ILI9325 ，verilog代码
电子技术交流论坛 iamxiaozhang 2013-12-1 0 1212 iamxiaozhang 2013-12-1 10:38
基于verilog的简易频率计
verilog ，频率计 ，hz ，方波 ，精度
新手园地 启航xin 2013-11-21 7 1621 lufeijian 2013-11-25 22:15
关于verilog实现CRC的问题 attach_img
CRC ，verilog ，AC ，校验码
FPGA论坛 fengfei19901026 2013-11-20 11 2119 14730497 2013-12-3 17:30
或许自己没有竞争力，fpga的工作真难找！
FPGA ，verilog ，代码 ，工程师 ，电子
FPGA论坛 zhang-sb23 2013-11-13 23 4281 youkaiyuan 2013-12-6 22:47
一个Verilog新手问题 attach_img
verilog ，edge ，POS ，se ，os
FPGA论坛 supers001 2013-11-7 7 1293 supers001 2013-11-10 16:13
基于FPGA的用verilog hdl编写16位CPU程序
CPU ，FPGA ，编写 ，HDL ，verilog
EDA 技术 prince梅子54 2013-11-20 1 1625 gaochy1126 2013-11-26 17:25
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