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明德扬FPGA连载课程第一阶段第三章VERILOG(1) 电子技术交流论坛 guyu_1 2018-11-5 0 652 guyu_1 2018-11-5 20:23
对分频器ip核的不理解 attach_img FPGA论坛 呱呱年 2018-10-21 4 1854 forrest11 2018-10-29 12:50
verilog请教 attach_img 新手园地 欢乐的小僵尸 2018-10-17 2 527 零三翟邢止胃 2019-3-25 09:03
明德扬至简设计法--verilog的综合器和仿真器 attach_img FPGA论坛 明德扬fpga 2018-10-8 0 646 明德扬fpga 2018-10-8 15:54
用Verilog或VHDL写一段代码,实现消除一个glitch?
verilogVHDL代码tc
新手园地 一片混沌 2018-9-11 0 142 一片混沌 2018-9-11 12:02
如何用VERILOG或VHDL写一段代码,实现10进制计数器? 新手园地 道子 2018-9-11 0 257 道子 2018-9-11 10:14
怎么区分哪些buffer/inverter是CTS插入的,哪些是原Verilog网表里的? 新手园地 第十代火影 2018-9-10 0 272 第十代火影 2018-9-10 14:12
PL031 Verilog生成 新手园地 求关注啊 2018-9-9 0 192 求关注啊 2018-9-9 20:32
modelsim无法建立project FPGA论坛 VCrawford 2018-9-7 0 1348 VCrawford 2018-9-7 11:02
关于仿真软件modelsim无法建立工程 EDA 技术 VCrawford 2018-9-7 2 2844 gaochy1126 2018-10-7 12:05
VERILOG FPGA论坛 qqbacon1s 2018-9-7 3 821 蒋哈哈 2018-11-24 17:55
fpga设计pid 新手园地 怎么叫都可以 2018-8-31 0 223 怎么叫都可以 2018-8-31 15:00
读《FPGA设计技巧与案例开发详解》第2-3章笔记 新手园地 电子学长 2018-8-23 0 234 电子学长 2018-8-23 12:48
Verilog的for循环的相关问题 FPGA论坛 平漂流 2018-8-22 3 2322 蒋哈哈 2018-11-24 18:50
亚稳态及异步复位同步释放电路请教 电子技术交流论坛 hanmyao 2018-8-6 0 690 hanmyao 2018-8-6 16:53
请教一下Verilog数据处理问题 FPGA论坛 ruiyang89 2018-7-21 1 1230 chym129 2018-7-28 19:06
verilog码代码非常好用的编辑软件【Gvim】 attachment FPGA论坛 明德扬fpga 2018-7-12 4 4782 baymaxlee 2023-8-17 20:22
4组数据混在一起,如何分离开来 attach_img FPGA论坛 paulkiyt 2018-6-12 6 1070 stickler 2018-6-18 09:04
Cadence16.X中Verilog file如何支持Pspice仿真 EDA 技术 zrkdzsj521 2018-6-3 0 1132 zrkdzsj521 2018-6-3 10:34
有偿求帮忙调试一个后仿 FPGA论坛 tiqiunanhai 2018-5-30 7 1434 tiqiunanhai 2018-8-5 21:14