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同呼唤大神,如何在一个vhdl中同时用上升和下降沿
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vhdl语法求解
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求助:modelsim中如何对VHDL仿真 FPGA论坛 nm2012 2013-10-16 7 1898 ococ 2013-10-17 15:28
VHDL 语法求解
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cpld写lcd的时序,第一次写vhdl,大家帮忙看看有问题没 attach_img
CPLDLCDVHDL时序
FPGA论坛 zhubright 2013-9-18 6 1820 EDAbuffalo 2013-11-8 21:50
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CPLDHDLVHDL控制编写
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verilog是否有record类型 FPGA论坛 yghanwuji 2013-8-14 1 1654 resxpl 2013-8-14 23:15
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信号脉冲HDLVHDL电路
EDA 技术 commander001 2013-8-11 14 2370 EDAbuffalo 2013-11-9 23:32
延时
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FPGA论坛 胡蒙云 2013-8-4 5 2031 EDAbuffalo 2013-11-8 21:10
举例说明VHDL中关于变量和信号的赋值、if语句的描述方法 attach_img
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FPGA论坛 mhanchen 2013-7-30 14 5407 admiration123 2015-9-25 09:16
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FPGA论坛 醉小清风 2013-7-30 2 1466 GoldSunMonkey 2013-7-31 00:02
VHDL里一个警告的问题
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FPGA论坛 yb22771973 2013-7-22 4 1618 GoldSunMonkey 2013-7-23 00:14
VHDL函数的使用
函数VHDLgeBCDCD
FPGA论坛 damoyeren 2013-7-18 15 1891 GoldSunMonkey 2013-7-29 21:46
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(VHDL)奇数或偶数分频器如何设计?还有占空比怎么设计的啊?
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FPGA论坛 Death格雷尔 2013-7-9 5 2685 GoldSunMonkey 2013-7-10 20:33
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VHDL与Verilog HDL的区别 FPGA论坛 GoldSunMonkey 2013-9-6 0 1023 GoldSunMonkey 2013-9-6 23:21