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reg和wire有什么区别啊？
时序逻辑 ，时序 ，逻辑 ，逻辑电路 ，电路 ，Wire
Microchip Henryko 2023-12-18 7 860 亚瑟 2023-12-29 09:59
单片机与芯片的通信时序图，求解答 attach_img
时序图 ，时序 ，时序逻辑 ，接口时序 ，静态时序分析 ，时序配置
电子技术交流论坛 银尘123 2023-6-2 0 876 银尘123 2023-6-2 16:26
在FPGA中何时用组合逻辑或时序逻辑 attach_img
FPGA ，PGA ，时序 ，时序逻辑 ，BSP
FPGA论坛 FPGA技术江湖 2023-3-6 0 943 FPGA技术江湖 2023-3-6 16:45
FPGA零基础学习：数字电路中的时序逻辑 attach_img
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FPGA论坛 FPGA技术江湖 2023-2-22 0 1286 FPGA技术江湖 2023-2-22 17:19
关于Verilog中begin···end语句执行顺序
时序逻辑 ，时序 ，阻塞赋值 ，阻塞 ，顺序 ，verilog
EDA 技术 gaochy1126 2023-2-18 0 2424 gaochy1126 2023-2-18 15:45
组合逻辑与时序逻辑为什么要分开写
时序逻辑 ，ge ，edge ，ST ，RS
FPGA论坛 fpgalover 2019-9-23 1 1264 llaill2014 2019-12-25 14:21
FPGA实现各种算法（尤其复杂算法）
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创业|外包|承接 hekaibuaa 2018-9-8 3 3077 hekaibuaa 2018-9-10 12:12
勇敢的芯伴你玩转Altera FPGA连载25：组合逻辑与时序逻辑 attach_img
altera ，FPGA ，时序逻辑 ，AlteraFPGA
FPGA论坛 rousong1989 2017-11-17 1 953 原子弹001 2017-11-19 15:06
明德扬FPGA设计模板分享(1)
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FPGA论坛 xuehua_12 2017-4-26 0 750 xuehua_12 2017-4-26 16:37
哥哥们姐姐们，最基础的难道是最难的吗，时序逻辑设计 attachment
时序逻辑 ，逻辑设计 ，AC ，CD ，CD4013
电子技术交流论坛 ecoren 2015-6-12 5 1297 chunyang 2015-6-12 21:24
请教个问题，如何实现如下时序逻辑 attach_img
时序逻辑 ，时钟 ，器件 ，控制 ，控制器
模拟技术论坛 mic1984 2015-3-31 8 1072 captzs 2015-4-3 21:48
至芯科技zx-2fpga开发板，初学者实践学习之数码管简单评测
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FPGA论坛 fpgaw 2014-4-23 0 1386 fpgaw 2014-4-23 13:29
组合逻辑下面不能再用时序逻辑
时序逻辑 ，Pulse ，se ，npu ，ni
FPGA论坛 entepino 2014-1-16 1 1271 huangxz 2014-1-16 23:01
逻辑控制问题
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FPGA论坛 aikimi7 2013-9-11 2 1446 aikimi7 2013-9-11 18:02
ripple clock
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FPGA论坛 ifpga 2013-3-22 5 1626 GoldSunMonkey 2013-3-24 21:55
Verilog assign和always 注意事宜
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FPGA论坛 FangTT 2013-1-30 12 2203 FangTT 2013-3-18 17:14
Verilog assign和always 注意事宜
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FPGA论坛 星星之火红 2012-10-13 12 1924 Backkom80 2012-11-14 08:11
三角波整形问题
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模拟技术论坛 magic_yuan 2012-11-10 4 2258 magic_yuan 2012-11-24 20:57
组合逻辑与时序逻辑疑问
时序逻辑 ，edge ，POS ，verilog ，verilo
FPGA论坛 magic_yuan 2013-4-1 8 3324 magic_yuan 2013-4-2 10:46
组合逻辑和时序逻辑的关系
时序逻辑 ，TE ，ic ，ge ，ST
EDA 技术 damoyeren 2013-6-27 0 1258 damoyeren 2013-6-27 11:12
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